学会System Generator(10)——支持的MATLAB语法

发表于:08/13/2018 , 关键词: Matlab, System Generator
本文是该系列的第10篇,上一篇介绍了在System Generator设计中使用MCode模块调用MATLAB代码来完成逻辑控制。本文将介绍System Generator支持的所有MATLAB语法。 限于篇幅,本文只记录了经常用到或相对重要的内容,更详细的信息可以参考xilinx官方文档ug958->第一章->MCode小节。 MCode block特性... 阅读详情

Zynq平台移植知识点

发表于:08/13/2018 , 关键词: 移植, Zynq
一、嵌入式Linux系统组成 zynq平台上的Linux系统由四部分组成:BOOT.bin、devicetree.dtb、uImage、uramdisk.image.gz。 (1)BOOT.bin:启动引导程序,包括第一阶段引导程序(FSBL)和第二阶段引导程序(SSBL),zynq平台上一般还需要一个system.bit文件,用于构建PL部分。 (2)uImage:linux系统核心部分,... 阅读详情

Vivado常见问题集锦

发表于:08/10/2018 , 关键词: Vivado
作者:NingHeChuan(宁河川)  对于电子工程师来说,很多电路设计仿真软件都是特别大的,安装下来一般都是上G,甚至几十G,而且win7的兼容性也是最好的,不愿意升级win10是因为麻烦,而且没有必要,对于很多的设计软件来说win10还没有完全兼容,而且还不停自动更新,时间很珍贵的,谁愿意浪费大把时间搞什么兼容性问题,而不是code or design。... 阅读详情

SDSoc学习(四):搭建包含AXI_GPIO的平台(解决找不到基地址的问题)

发表于:08/10/2018 , 关键词: ZedBoard, SDSoC
简介 本篇博客大部分内容前三篇博客都已经包含了,此处重点叙述不同之处,主要对比Tcl命令的不同和解决SDSoc程序找不到基地址的问题。 使用ZedBoard开发板,SDSoc 2017.4, Win10系统;此处通过AXI_GPIO点亮ZedBoard板子上连接在PL端的8个LED灯。 Tcl命令 搭建平台的步骤在 SDSoc学习(二)中进行了较为详细的描述,... 阅读详情

8个Python高效数据分析的技巧

发表于:08/10/2018 , 关键词: python, 高效数据分析
作者 | Conor Dewey编译 | 专知整理 | Yingying, Jiahui 不管是参加Kaggle比赛,还是开发一个深度学习应用,第一步总是数据分析,这篇文章介绍了8个使用Python进行数据分析的方法,不仅能够提升运行效率,还能够使代码更加“优美”。 一行代码定义List 定义某种列表时,写For 循环过于麻烦,幸运的是,Python有一种内置的方法可以在一行代码中解决这个问题。

学会System Generator(9)——MCode调用MATLAB代码

发表于:08/10/2018 , 关键词: Matlab, system-generator
本文是该系列的第9篇。FPGA设计中经常用到一些控制逻辑,如有限状态机(FSM),如果用各种block搭建一个FSM比较麻烦。System Generator支持调用MATLAB代码,通常可以编写MATLAB代码来实现FSM等控制逻辑,通过MCode block调用到System Generator设计中。 本文将使用MATLAB代码设计一个FSM,对“1011”这个序列进行检测。... 阅读详情

用Python玩FPGA背后的故事

发表于:08/09/2018 , 关键词: FPGA, python, 今日头条
近日,想必各位科技爱好者的朋友圈都被一篇发表在第25届IEEE国际讨论会上,用Python开发FPGA的论文刷屏了吧,那么这是如何实现的呢?今天,就请各位看官和小编一起来了解一下,这个构想的实现基础——PYNQ。 图为该篇论文

【视频教程】Simulink:仿真与基于模型的设计

发表于:08/09/2018 , 关键词: Simulink, 仿真
Simulink 是一个面向多域仿真并和基于模型设计的框模块图环境。它支持系统级设计、仿真、自动代码生成以及嵌入式系统的连续测试和验证。在迁移到硬件之前,在 Simulink 中设计和仿真您的系统。探索和实现您原本不会考虑在内的设计 ,而无需编写 C、C++ 或 HDL 代码。

突破功能安全设计的复杂性

发表于:08/09/2018 , 关键词: 功能安全
作者:Paul S.Levy, 赛灵思功能安全系统高级工程师 “功能安全(Functional Safety)”研究的是机器发生故障或运行环境中断时如何降低其对人和设备造成的危害的方法和措施。试想一下,在刚刚结束的 2018年的足球世界杯(2018 FIFA)中,如果我们将这种研究应用到足球比赛中,裁判员就有能力和权力在他们觉得有犯规行为时暂停比赛。当然,... 阅读详情

开发套件:SingleA Virtex-7 2000T 模块

发表于:08/09/2018 , 关键词: S2C, 今日头条, Virtex-7
产品编号:TAILMV2000SA-ES 供应商:S2C Incorporated 器件支持:Virtex-7 产品描述 SingleA Virtex-7 2000ES Prodigy 逻辑模块不仅可采用一个赛灵思 Vitex-7 2000ES FPGA 器件保持多达 2000 万个 ASIC 门的设计,而且还具有板上 DDR3 SO-DIMM 插口。该 Prodigy 逻辑模块现在支持 16... 阅读详情

SDSoc学习(三):用户自定义开发板搭建平台

发表于:08/08/2018 , 关键词: Z-7010
简介 前段时间买了一块米联客的7010开发板,打算尝试为这块开发板搭建一个简单平台。 用户自定义开发板与SDSoc直接支持的开发板的区别在于,直接支持的开发板已经根据板子上的硬件完成了一系列重要配置(如时钟、DDR型号),所以在为用户开发板搭建平台时,只需要根据该开发板的硬件实际情况进行相应的配置即可。 这里先尝试着点亮一个直接连在MIO(MIO7)上的LED。... 阅读详情

同步FIFO和异步FIFO

发表于:08/08/2018 , 关键词: 同步FIFO, 异步FIFO
1.定义   FIFO是英文First In First Out 的缩写,是一种先进先出的数据缓存器,他与普通存储器的区别是没有外部读写地址线,这样使用起来非常简单,但缺点就是只能顺序写入数据,顺序的读出数据, 其数据地址由内部读写指针自动加1完成,不能像普通存储器那样可以由地址线决定读取或写入某个指定的地址。   FIFO一般用于不同时钟域之间的数据传输,比如FIFO的一端是AD数据采集,... 阅读详情

电路板设计成关键 光收发器模块挺进400Gbps

发表于:08/08/2018 , 关键词: 400Gb以太网络, QSFP-DD, 光收发器
作者:周肇基/施天从/谢昆霖;新通讯 2018 年 8 月号 210 期《 技术前瞻 》 随着网络技术与物联网应用的发展,数据传输流量的需求也不断的增长。在数据传输技术中,下一个重大转变将是400Gb以太网络(400GbE)技术的推展与普及,400Gb以太网络技术预计将很快的会在各种云端服务、电信公司、以及需要超高带宽连接的应用环境中进行试用。... 阅读详情

基于Vivado HLS的一维离散卷积的高层次综合

发表于:08/08/2018 , 关键词: Vivado HLS, 一维离散卷积, 高层次综合
前言 利用vivado高层次综合工具可将C代码综合成HDL语言。本文将详细解析一维有限长离散卷积的例子,并分析综合结果。另外,vivado HLS的使用方法见笔者另一篇博文: http://xilinx.ck6jc.com/blog/13178 本文不再赘述。 维离散卷积原理 一维离散卷积就是卷积核与输入序列值两两相乘再求和,公式为: x为输入序列,y为输出数据,... 阅读详情

面向 PCI Express 的 UltraScale FPGA Gen3 集成块提供的 Vivado ILA 使用指南

发表于:08/08/2018 , 关键词: PCI-Express, UltraScale-FPGA-Gen3, Vivado-ILA
PCIe 链路训练及稳定性问题形成了绝大多数互联互通问题。 本文档主要介绍在带集成工具的 Xilinx Vivado 设计套件中调试这些问题的使用案例。 本文档将重点介绍如何通过捕获在 UltraScale FPGA Gen3 集成块中用于 PCI Express 内核的链路训练调试信号来使用 Vivado ILA 进行调试。
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